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Le laboratoire de l’EPFL développe une méthode de conception de circuits de faible puissance

Crédits: Pixabay / CC0 Public Domain Un laboratoire de l’Ecole Polytechnique Federale de Lausanne (EPFL) a mis au point un nouveau type de diagramme logique et des méthodes d’optimisation associées, qui peuvent être utilisées pour concevoir des puces informatiques avec un gain de près de 20% en efficacité énergétique, en vitesse ou en taille. Le […]